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 第3類是基于PC總線的以DSP或FPGA作為核心處理器的開放式運動控制器。這類開放式運動控制器以DSP芯片作為運動控制器的核心處理器，以PC機(jī)作為信息處理平臺，運動控制器以插件形式嵌入PC機(jī)，即“PC+運動控制器”的模式。這樣的運動控制器具有信息處理能力強(qiáng)，開放程度高，運動軌跡控制準(zhǔn)確，通用性好的特點。但是這種方式存在以下缺點：運動控制卡需要插入計算機(jī)主板的PCI或者ISA插槽，因此每個具體應(yīng)用都必須配置一臺PC機(jī)作為上位機(jī)。這無疑對設(shè)備的體積、成本和運行環(huán)境都有一定的限制，難以獨立運行和小型化。
微型
微控制器（MicroController）又可簡稱MCU或μC，也有人稱為單芯片微控制器（Single Chip Microcontroller），將ROM、RAM、CPU、I/O集合在同一個芯片中,為不同的應(yīng)用場合做不同組合控制。微控制器在經(jīng)過這幾年不斷地研究、發(fā)展，歷經(jīng)4位、8位，到如今的16位及32位，甚至64位。產(chǎn)品的成熟度，以及投入廠商之多、應(yīng)用范圍之廣，真可謂之*。在國外大廠因開發(fā)較早、產(chǎn)品線廣，所以技術(shù)，而本土廠商則以多功能為產(chǎn)品導(dǎo)向取勝。
基本功能
數(shù)據(jù)緩沖：由于I/O設(shè)備的速率較低而CPU和內(nèi)存的速率卻很高，故在控制器中必須設(shè)置一緩沖器。在輸出時，用此緩沖器暫存由主機(jī)高速傳來的數(shù)據(jù)，然后才以I/O設(shè)備所具有的速率將緩沖器中的數(shù)據(jù)傳送給I/O設(shè)備；在輸入時，緩沖器則用于暫存從I/O設(shè)備送來的數(shù)據(jù)，待接收到一批數(shù)據(jù)后，再將緩沖器中的數(shù)據(jù)高速地傳送給主機(jī)。
差錯控制：設(shè)備控制器還兼管對由I/O設(shè)備傳送來的數(shù)據(jù)進(jìn)行差錯檢測。若發(fā)現(xiàn)傳送中出現(xiàn)了錯誤，通常是將差錯檢測碼置位，并向 CPU報告，于是CPU將本次傳送來的數(shù)據(jù)作廢，并重新進(jìn)行一次傳送。這樣便可保證數(shù)據(jù)輸入的正確性。
數(shù)據(jù)交換：這是指實現(xiàn)CPU與控制器之間、控制器與設(shè)備之間的數(shù)據(jù)交換。對于前者，是通過數(shù)據(jù)總線，由CPU并行地把數(shù)據(jù)寫入控制器，或從控制器中并行地讀出數(shù)據(jù)；對于后者，是設(shè)備將數(shù)據(jù)輸入到控制器，或從控制器傳送給設(shè)備。為此，在控制器中須設(shè)置數(shù)據(jù)寄存器。

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